概述
74HC138是一款高速CMOS器件,74HC138引脚兼容低功耗肖特基TTL(LSTTL)系列。
74HC138译码器可接受3位二进制加权地址输入(A0, A1和A2),并当使能时,提供8个互斥的低有效输出(Y0至Y7)。74HC138特有3个使能输入端:两个低有效(E1和E2)和一个高有效(E3)。除非E1和E2置低且E3置高,否则74HC138将保持所有输出为高。利用这种复合使能特性,仅需4片74HC138芯片和1个反相器,即可轻松实现并行扩展,组合成为一个1-32(5线到32线)译码器。任选一个低有效使能输入端作为数据输入,而把其余的使能输入端作为选通端,则74HC138亦可充当一个8输出多路分配器,未使用的使能输入端必须保持绑定在各自合适的高有效或低有效状态。
74HC138与74HC238逻辑功能一致,只不过74HC138为反相输出。
2功能
CD74HC138 ,CD74HC238和CD74HCT138 , CD74HCT238是高速硅栅CMOS解码器,适合内存地址解码或数据路由应用。74HC138 作用原理于高性能的存贮译码或要求传输延迟时间短的数据传输系统,在 高性能存贮器系统中,用这种译码器可以提高译码系统的效率。将快速赋能电路用于高速存贮器时,译码器的延迟时间和存贮器的赋能时间通常小于存贮器的典型存取时间,这就是说由肖特基钳位的系统译码器所引起的有效系统延迟可以忽略不计。HC138 按照三位二进制输入码和赋能输入条件,从8 个输出端中译出一个 低电平输出。两个低电平有效的赋能输入端和一个高电平有效的赋能输入端减少了扩展所需要的外接门或倒相器,扩展成24 线译码器不需外接门;扩展成32 线译码器,只需要接一个外接倒相器。在解调器应用中,赋能输入端可用作数据输入端。
3译码/真值表
74HC138集成译码器功能表[1]
4特性
复合使能输入,轻松实现扩展 兼容JEDEC标准no.7A 存储器芯片译码选择的理想选择 低有效互斥输出 ESD保护 HBM EIA/JESD22-A114-C超过2000 V MM EIA/JESD22-A115-A超过200 V 温度范围 -40~+85 ℃ -40~+125 ℃ 多路分配功能
5技术参数
电压 2.0~6.0V
驱动电流 ±5.2mA
传输延迟 12ns@5V
逻辑电平 CMOS
功耗考量 低功耗或电池供电应用
封装与引脚 SO16、SSOP16、DIP16、TSSOP16
奇江电子主营范围:
电源管理IC 运放比较器IC 音频功放IC 三端稳压IC
锂电保护IC CD4000系列 LED驱动IC EEPROM 存储器
CR6224 CR6228 OB2263 OB2535 OB2538 CD4520 CD4511 CD4001 CD4017 CD4024 CD4046 CD4541 CD4060 CD4070 CD4081 CD4052 CD4517 CD4011 CD4020 CD4093 CD4066 CD4543 CD4528
LM258 LM358 LM393 LM324 LM339 LM386 DS1302 DS1307 PCF8563 NE555 NE5532 JRC4558 THX203 ULN2003 ULN2803 HT1628 HT1621B HT6221 HT6222 OP07 4953 9435A TL062 TL084AT24C01 AT24C02 AT24C04 AT24C08 AT24C16 AT24C64 AT24C128 ..........
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